可編程器件:Virtex? UltraScale

Virtex? UltraScale? 器件在 20nm 提供最佳性能與集成，包含串行 I/O 帶寬和邏輯容量。作為在 20nm 工藝節(jié)點(diǎn)的業(yè)界僅有高端 FPGA，此系列適合從 400G 網(wǎng)絡(luò)到大型 ASIC 原型設(shè)計(jì)/仿真的應(yīng)用。 可編程系統(tǒng)集成\t\r\n·多達(dá) 5.5M 系統(tǒng)邏輯單元，采用 20nm 工藝，和第 2 代 3D IC\r\n·集成式 100G 以太網(wǎng) MAC 和 150G Interlaken 內(nèi)核\r\n\r\n提升的系統(tǒng)性能\t\r\n·高利用率使速度提升兩個(gè)等級(jí)\r\n·30G 收發(fā)器: 用于芯片對(duì)芯片、芯片對(duì)光纖和 28G 背板的 30G 收發(fā)器\r\n·功耗減半的 16G 背板收發(fā)器\r\n·2400Mb/s DDR4 可穩(wěn)定工作在不同 PVT 條件下\r\n\r\nBOM 成本削減\t\r\n·成本降低達(dá) 50% – 是 Nx100G 系統(tǒng)每端口成本的?\r\n·VCXO 與 fPL;

AMD

超威半導(dǎo)體

DLP160AP 0.16 QnHD DMD

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TI

德州儀器

DLP160CP 0.16 nHD DMD

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TI

德州儀器

16-Bit Single-Chip Real Time Signal Controller XE166 Family / Compact Line

1 Summary of Features For a quick overview and easy reference, the features of the XE160FU are summarized here. ? High-performance CPU with five-stage pipeline and MPU – 15.2 ns instruction cycle @ 66 MHz CPU clock (single-cycle execution) – One-cycle 32-bit addition and subtraction with 40-b

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