1:3 LVPECL CLOCK BUFFER WITH PROGRAMMABLE DIVIDER

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具有可編程分頻器的 1:3 LVPECL 時鐘緩沖器

The CDCP1803 clock driver distributes one pair of differential clock inputs to three pairs of LVPECL differential clock outputs Y[2:0] and Y[2:0] with minimum skew for clock distribution. The CDCP1803 is specifically designed for driving 50-? transmission lines. The CDCP1803 has three control termin ? Distributes One Differential Clock Input to Three LVPECL Differential Clock Outputs\n? Low-Output Skew 15 ps (Typical)\n? Signaling Rate Up to 800-MHz LVPECL\n? Provides VBB Bias Voltage Output for Single-Ended Input Signals\n? 24-Terminal QFN Package (4 mm × 4 mm)\n? Accepts Any Differential Sign;

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