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首頁 >CDC2516>規(guī)格書列表

型號(hào)	下載訂購	功能描述	制造商上傳企業(yè)	LOGO
CDC2516	文件：1.06695 Mbytes Page：17 Pages	3.3-V PHASE-LOCK LOOP CLOCK DRIVER Use CDCVF2510A as a Replacement for this Device Phase-Lock Loop Clock Distribution for Synchronous DRAM Applications Distributes One Clock Input to Four Banks of Four Outputs Separate Output Enable for Each Output Bank External Feedback Pin (FBIN) Is Used to Synchronize the Outputs to the 文件：1.06695 Mbytes 頁數(shù)：17 Pages	TI 德州儀器	TI
CDC2516	文件：160.19 Kbytes Page：11 Pages	3.3-V PHASE-LOCK LOOP CLOCK DRIVER 文件：160.19 Kbytes 頁數(shù)：11 Pages	TI 德州儀器	TI
CDC2516	文件：479.93 Kbytes Page：15 Pages	3.3V Phase- Lock Loop Clock Driver 文件：479.93 Kbytes 頁數(shù)：15 Pages	TI 德州儀器	TI
CDC2516DGGR	文件：1.06695 Mbytes Page：17 Pages	絲?。?strong>CDC2516；Package：TSSOP；3.3-V PHASE-LOCK LOOP CLOCK DRIVER Use CDCVF2510A as a Replacement for this Device Phase-Lock Loop Clock Distribution for Synchronous DRAM Applications Distributes One Clock Input to Four Banks of Four Outputs Separate Output Enable for Each Output Bank External Feedback Pin (FBIN) Is Used to Synchronize the Outputs to the 文件：1.06695 Mbytes 頁數(shù)：17 Pages	TI 德州儀器	TI
CDC2516DGGR.B	文件：1.06695 Mbytes Page：17 Pages	絲?。?strong>CDC2516；Package：TSSOP；3.3-V PHASE-LOCK LOOP CLOCK DRIVER Use CDCVF2510A as a Replacement for this Device Phase-Lock Loop Clock Distribution for Synchronous DRAM Applications Distributes One Clock Input to Four Banks of Four Outputs Separate Output Enable for Each Output Bank External Feedback Pin (FBIN) Is Used to Synchronize the Outputs to the 文件：1.06695 Mbytes 頁數(shù)：17 Pages	TI 德州儀器	TI
CDC2516	文件：300 bytes Page：1 Pages	具有三態(tài)輸出的 3.3V 相位鎖定環(huán)路時(shí)鐘驅(qū)動(dòng)器 The CDC2516 is a high-performance, low-skew, low-jitter, phase-lock loop (PLL) clock driver. It uses a PLL to precisely align, in both frequency and phase, the feedback output (FBOUT) to the clock (CLK) input signal. It is specifically designed for use with synchronous DRAMs. The CDC2516 operates at ? Use CDCVF2510A as a Replacement for this Device\n? Phase-Lock Loop Clock Distribution for Synchronous DRAM Applications\n? Distributes One Clock Input to Four Banks of Four Outputs\n? Separate Output Enable for Each Output Bank\n? External Feedback Pin (FBIN) Is Used to Synchronize the Outputs to ;	TI 德州儀器	TI
CDC2516_08	文件：479.93 Kbytes Page：15 Pages	3.3V Phase- Lock Loop Clock Driver 文件：479.93 Kbytes 頁數(shù)：15 Pages	TI 德州儀器	TI
CDC2516DGG	文件：160.19 Kbytes Page：11 Pages	3.3-V PHASE-LOCK LOOP CLOCK DRIVER 文件：160.19 Kbytes 頁數(shù)：11 Pages	TI 德州儀器	TI
CDC2516DGGR	文件：479.93 Kbytes Page：15 Pages	3.3V Phase- Lock Loop Clock Driver 文件：479.93 Kbytes 頁數(shù)：15 Pages	TI 德州儀器	TI
CDC2516DGGRG4	文件：479.93 Kbytes Page：15 Pages	3.3V Phase- Lock Loop Clock Driver 文件：479.93 Kbytes 頁數(shù)：15 Pages	TI 德州儀器	TI

技術(shù)參數(shù)

Additive RMS jitter (Typ) (fs)：
200
Output frequency (Max) (MHz)：
125
Number of outputs：
16
Output supply voltage (V)：
3.3
Core supply voltage (V)：
3.3
Output skew (ps)：
250
Features：
1
Operating temperature range (C)：
0 to 70
Rating：
Catalog
Output type：
TTL
Input type：
TTL

供應(yīng)商	型號(hào)	品牌	批號(hào)	封裝	庫存	備注	價(jià)格
深圳市一線半導(dǎo)體有限公司	CDC2516	TI	24+	SOP	2426		詢價(jià)
艾睿（深圳）半導(dǎo)體有限公司	CDC2516	TI/德州儀器	2447	TSSOP48	100500	一級(jí)代理專營品牌!原裝正品,優(yōu)勢(shì)現(xiàn)貨,長期排單到貨	詢價(jià)
深圳市宇創(chuàng)芯科技有限公司	CDC2516	TI/德州儀器	24+	TSSOP	9600	原裝現(xiàn)貨,優(yōu)勢(shì)供應(yīng),支持實(shí)單!	詢價(jià)
深圳市恒科翔業(yè)電子有限公司	CDC2516	TI德州儀器	22+		24000	原裝正品現(xiàn)貨,實(shí)單可談,量大價(jià)優(yōu)	詢價(jià)
深圳市益百分電子有限公司	CDC2516DGGR	TI	07+	SSOP	2550	全新原裝進(jìn)口自己庫存優(yōu)勢(shì)	詢價(jià)
深圳市卓越微芯電子有限公司	CDC2516DGGR	TI	25+	N/A	1369	百分百原裝正品真實(shí)公司現(xiàn)貨庫存本公司只做原裝可	詢價(jià)
深圳市福安甌科技有限公司	CDC2516DGGR	TI	25+	TSSOP48	200	主打產(chǎn)品,長備大量現(xiàn)貨	詢價(jià)
深圳市聯(lián)世界科技有限公司	CDC2516DGGR	TEXAS	24+/25+		458	原裝正品現(xiàn)貨庫存價(jià)優(yōu)	詢價(jià)
芯有半導(dǎo)體（深圳）有限公司	CDC2516DGGR	TI	00/01+	TSSOP48	2885	全新原裝100真實(shí)現(xiàn)貨供應(yīng)	詢價(jià)
深圳市利加科技有限公司	CDC2516DGGRG4	TI	16+	TSSOP-48	8000	原裝現(xiàn)貨請(qǐng)來電咨詢	詢價(jià)

更多CDC2516供應(yīng)商更新時(shí)間2026-1-18 16:30:00

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