DDR Termination Regulator

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LP2996-N DDR Termination Regulator

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DDR Termination Regulator

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具有 DDR2/3/3L 關(guān)斷引腳的 1.5A DDR 終端穩(wěn)壓器

LP2996A 線性穩(wěn)壓器的設(shè)計(jì)符合 DDR-SDRAM 端接的 JEDEC SSTL-2 規(guī)范。 此器件還支持 DDR2、DDR3 和 DDR3L VTT 總線端接，VDDQ 最小值為 1.35V。 此器件包含高速運(yùn)算放大器，可提供出色的負(fù)載瞬變響應(yīng)。 輸出級可防止在 DDR-SDRAM 端接所需的應(yīng)用中提供 1.5A 連續(xù)電流和最大 3A 的瞬態(tài)峰值電流時發(fā)生直通。 LP2996A 還包含一個 VSENSE 引腳（用于提供出色的負(fù)載調(diào)節(jié)），以及一個 VREF 輸出（作為芯片組和 DIMM 的參考）。 LP2996A 的一個附加特性是具有一個低電平有效關(guān)斷 (SD) 引腳，該引腳提供“掛起到 ? VDDQ 最小值為 1.35V\n? 拉電流和灌電流\n? 低輸出電壓偏移\n? 無需外部電阻\n? 線性拓?fù)鋅n? 掛起到 RAM (STR) 功能\n? 低外部元件數(shù)\n? 熱關(guān)斷\n? -40°C 至 125°C 條件下推薦使用 LP2998/8Q;

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具有 DDR2 關(guān)斷引腳的 1.5A DDR 終端穩(wěn)壓器

The LP2996-N and LP2996A linear regulators are designed to meet the JEDEC SSTL-2 specifications for termination of DDR-SDRAM. The device also supports DDR2, while LP2996A supports DDR3 and DDR3L VTT bus termination with VDDQ minimum of 1.35 V. The device contains a high-speed operational amplifier t ? Minimum VDDQ: \n? 1.8 V (LP2996-N)\n? 1.35 V (LP2996A)\n \n? Source and Sink Current\n? Low Output Voltage Offset\n? No External Resistors Required for Setting Output Voltage\n? Linear Topology\n? Suspend to Ram (STR) Functionality\n? Stable With Ceramic Capacitors With Appropriate ESR\n? Low Exte;

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Package：8-PowerSOIC（0.154"，3.90mm 寬）；包裝：卷帶（TR）剪切帶（CT）Digi-Reel? 得捷定制卷帶 類別：集成電路（IC） 電源管理 - 專用 描述：IC DDR TERMINATION REG 8SOPWRPAD

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Package：8-PowerSOIC（0.154"，3.90mm 寬）；包裝：托盤 類別：集成電路（IC） 電源管理 - 專用 描述：IC REGULATOR DDR TERM 8SOPWRPAD

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Package：16-WFQFN 裸露焊盤；包裝：卷帶（TR） 類別：集成電路（IC） 電源管理 - 專用 描述：IC DDR TERMINATION REG 16WQFN

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