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HEF4724	文件：71.4 Kbytes Page：7 Pages	8-bit addressable latch DESCRIPTION The HEF4724B is an 8-bit addressable latch with three address inputs (A0 to A2), a data input (D), an active LOW enable input (E), an active HIGH clear input (CL), and eight parallel latch outputs (O0 to O7). 文件：71.4 Kbytes 頁數：7 Pages	PHI PHI	PHI
HEF4724B	文件：71.4 Kbytes Page：7 Pages	8-bit addressable latch DESCRIPTION The HEF4724B is an 8-bit addressable latch with three address inputs (A0 to A2), a data input (D), an active LOW enable input (E), an active HIGH clear input (CL), and eight parallel latch outputs (O0 to O7). 文件：71.4 Kbytes 頁數：7 Pages	PHI PHI	PHI
HEF4724BD	文件：71.4 Kbytes Page：7 Pages	8-bit addressable latch DESCRIPTION The HEF4724B is an 8-bit addressable latch with three address inputs (A0 to A2), a data input (D), an active LOW enable input (E), an active HIGH clear input (CL), and eight parallel latch outputs (O0 to O7). 文件：71.4 Kbytes 頁數：7 Pages	PHI PHI	PHI
HEF4724BF	文件：71.4 Kbytes Page：7 Pages	8-bit addressable latch DESCRIPTION The HEF4724B is an 8-bit addressable latch with three address inputs (A0 to A2), a data input (D), an active LOW enable input (E), an active HIGH clear input (CL), and eight parallel latch outputs (O0 to O7). 文件：71.4 Kbytes 頁數：7 Pages	PHI PHI	PHI
HEF4724BN	文件：71.4 Kbytes Page：7 Pages	8-bit addressable latch DESCRIPTION The HEF4724B is an 8-bit addressable latch with three address inputs (A0 to A2), a data input (D), an active LOW enable input (E), an active HIGH clear input (CL), and eight parallel latch outputs (O0 to O7). 文件：71.4 Kbytes 頁數：7 Pages	PHI PHI	PHI
HEF4724BP	文件：71.4 Kbytes Page：7 Pages	8-bit addressable latch DESCRIPTION The HEF4724B is an 8-bit addressable latch with three address inputs (A0 to A2), a data input (D), an active LOW enable input (E), an active HIGH clear input (CL), and eight parallel latch outputs (O0 to O7). 文件：71.4 Kbytes 頁數：7 Pages	PHI PHI	PHI
HEF4724BT	文件：71.4 Kbytes Page：7 Pages	8-bit addressable latch DESCRIPTION The HEF4724B is an 8-bit addressable latch with three address inputs (A0 to A2), a data input (D), an active LOW enable input (E), an active HIGH clear input (CL), and eight parallel latch outputs (O0 to O7). 文件：71.4 Kbytes 頁數：7 Pages	PHI PHI	PHI
HEF4724BD	文件：300 bytes Page：1 Pages	8-bit addressable latch DESCRIPTION\nThe HEF4724B is an 8-bit addressable latch with three address inputs (A0 to A2), a data input (D), an active LOW enable input (E), an active HIGH clear input (CL), and eight parallel latch outputs (O0 to O7).	恩XP	恩XP

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齊創(chuàng)科技(上海,北京,青島)有限公司	HEF4724BP	PH	23+	SOP	5000	原裝正品,假一罰十	詢價
深圳市一線半導體有限公司	HEF4724BT	PHI	24+	SOP	38		詢價
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深圳市恒達億科技有限公司	HEF4724BT	PHI	25+	SOP	4500	全新原裝、誠信經營、公司現(xiàn)貨銷售	詢價
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更多HEF4724供應商更新時間2026-1-20 16:17:00

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