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CY2213	文件：103.05 Kbytes Page：10 Pages	High-Frequency Programmable PECL Clock Generator Introduction The CY2213 has a two-wire serial interface designed for data transfer operations, and is used for programming the P and Q values for frequency generation. Sclk is the serial clock line controlled by the master device. Sdata is a serial bidirectional data line. The CY2213 is a slave d 文件：103.05 Kbytes 頁數(shù)：10 Pages	CYPRESSCypress Semiconductor 賽普拉斯賽普拉斯半導(dǎo)體公司	CYPRESS
CY2213ZC-1	文件：103.05 Kbytes Page：10 Pages	High-Frequency Programmable PECL Clock Generator Introduction The CY2213 has a two-wire serial interface designed for data transfer operations, and is used for programming the P and Q values for frequency generation. Sclk is the serial clock line controlled by the master device. Sdata is a serial bidirectional data line. The CY2213 is a slave d 文件：103.05 Kbytes 頁數(shù)：10 Pages	CYPRESSCypress Semiconductor 賽普拉斯賽普拉斯半導(dǎo)體公司	CYPRESS
CY2213ZC-1T	文件：103.05 Kbytes Page：10 Pages	High-Frequency Programmable PECL Clock Generator Introduction The CY2213 has a two-wire serial interface designed for data transfer operations, and is used for programming the P and Q values for frequency generation. Sclk is the serial clock line controlled by the master device. Sdata is a serial bidirectional data line. The CY2213 is a slave d 文件：103.05 Kbytes 頁數(shù)：10 Pages	CYPRESSCypress Semiconductor 賽普拉斯賽普拉斯半導(dǎo)體公司	CYPRESS
CY2213ZC-2	文件：103.05 Kbytes Page：10 Pages	High-Frequency Programmable PECL Clock Generator Introduction The CY2213 has a two-wire serial interface designed for data transfer operations, and is used for programming the P and Q values for frequency generation. Sclk is the serial clock line controlled by the master device. Sdata is a serial bidirectional data line. The CY2213 is a slave d 文件：103.05 Kbytes 頁數(shù)：10 Pages	CYPRESSCypress Semiconductor 賽普拉斯賽普拉斯半導(dǎo)體公司	CYPRESS
CY2213ZC-2T	文件：103.05 Kbytes Page：10 Pages	High-Frequency Programmable PECL Clock Generator Introduction The CY2213 has a two-wire serial interface designed for data transfer operations, and is used for programming the P and Q values for frequency generation. Sclk is the serial clock line controlled by the master device. Sdata is a serial bidirectional data line. The CY2213 is a slave d 文件：103.05 Kbytes 頁數(shù)：10 Pages	CYPRESSCypress Semiconductor 賽普拉斯賽普拉斯半導(dǎo)體公司	CYPRESS
CY2213_12	文件：496.5 Kbytes Page：16 Pages	High Frequency Programmable PECL Clock Generator 文件：496.5 Kbytes 頁數(shù)：16 Pages	CYPRESSCypress Semiconductor 賽普拉斯賽普拉斯半導(dǎo)體公司	CYPRESS
CY2213ZXC-1	文件：496.5 Kbytes Page：16 Pages	High Frequency Programmable PECL Clock Generator 文件：496.5 Kbytes 頁數(shù)：16 Pages	CYPRESSCypress Semiconductor 賽普拉斯賽普拉斯半導(dǎo)體公司	CYPRESS
CY2213ZXC-1T	文件：496.5 Kbytes Page：16 Pages	High Frequency Programmable PECL Clock Generator 文件：496.5 Kbytes 頁數(shù)：16 Pages	CYPRESSCypress Semiconductor 賽普拉斯賽普拉斯半導(dǎo)體公司	CYPRESS
CY2213ZXC-1T	文件：300 bytes Page：1 Pages	Timing Solutions - Clocks - Standard Performance Clock Generators -	Infineon 英飛凌	Infineon
CY2213ZXC-2	文件：300 bytes Page：1 Pages	IC PROG PECL CLOCK GEN 16-TSSOP	Infineon 英飛凌	Infineon

技術(shù)參數(shù)

Core Voltage (V)：
3.3
I/O Voltage (V)：
3.3
Input Frequency Max. (MHz)：
133
Input Frequency Min. (MHz)：
1
Input Signal Type：
Xtal
Max. Operating Temp. (°C)：
70
Max. Operating Voltage (V)：
3.60
Min. Operating Temp. (°C)：
0
Min. Operating Voltage (V)：
3.00
No. of Outputs：
1
No. of PLL：
1
Output Frequency Max. (MHz)：
400
Output Frequency Min. (MHz)：
125
Output Signal Type：
LVPECL
Spread Spectrum：
N
Tape & Reel：
N
Temp. Classification：
Commercial

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更多CY2213供應(yīng)商更新時(shí)間2026-1-18 13:57:00

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