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CD74ACT109E.A	文件：412.14 Kbytes Page：14 Pages	絲印：CD74ACT109E；Package：PDIP；DUAL J-K POSITIVE-EDGE-TRIGGERED FLIP-FLOPS WITH CLEAR AND PRESET Inputs Are TTL-Voltage Compatible Speed of Bipolar F, AS, and S, With Significantly Reduced Power Consumption Balanced Propagation Delays ±24-mA Output Drive Current – Fanout to 15 F Devices SCR-Latchup-Resistant CMOS Process and Circuit Design Exceeds 2-kV ESD Protection Per MIL-STD-883, 文件：412.14 Kbytes 頁數(shù)：14 Pages	TI 德州儀器	TI
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