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74F385	文件：64.3 Kbytes Page：6 Pages	Quad serial adder/subtractor DESCRIPTION The 74F385 contains four independent adder/subtractor elements with common Clock and Master Reset. Each adder/subtractor contains a sum flop-flop and a carry flip-flop for synchronous operations. Flip-flop state changes occur on the rising edge of the Clock Pulse (CP) input signal. Th 文件：64.3 Kbytes 頁(yè)數(shù)：6 Pages	PHI PHI	PHI
74F385	文件：300 bytes Page：1 Pages	Quad serial adder/subtractor	恩XP	恩XP
N74F385D	文件：64.3 Kbytes Page：6 Pages	Quad serial adder/subtractor DESCRIPTION The 74F385 contains four independent adder/subtractor elements with common Clock and Master Reset. Each adder/subtractor contains a sum flop-flop and a carry flip-flop for synchronous operations. Flip-flop state changes occur on the rising edge of the Clock Pulse (CP) input signal. Th 文件：64.3 Kbytes 頁(yè)數(shù)：6 Pages	PHI PHI	PHI
N74F385N	文件：64.3 Kbytes Page：6 Pages	Quad serial adder/subtractor DESCRIPTION The 74F385 contains four independent adder/subtractor elements with common Clock and Master Reset. Each adder/subtractor contains a sum flop-flop and a carry flip-flop for synchronous operations. Flip-flop state changes occur on the rising edge of the Clock Pulse (CP) input signal. Th 文件：64.3 Kbytes 頁(yè)數(shù)：6 Pages	PHI PHI	PHI

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