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首頁 >74F113>規(guī)格書列表

型號	下載訂購	功能描述	制造商上傳企業(yè)	LOGO
74F113	文件：59.83 Kbytes Page：6 Pages	Dual JK Negative Edge-Triggered Flip-Flop General Description The 74F113 offers individual J, K, Set and Clock inputs. When the clock goes HIGH the inputs are enabled and data may be entered. The logic level of the J and K inputs may be changed when the clock pulse is HIGH and the flipflop will perform according to the Truth Table as lo 文件：59.83 Kbytes 頁數(shù)：6 Pages	FAIRCHILD 仙童半導(dǎo)體	FAIRCHILD
74F113	文件：81.65 Kbytes Page：10 Pages	Dual J-K negative edge-triggered flip-flops without reset DESCRIPTION The 74F113, dual negative edge-triggered JK-type flip-flop, features individual J, K, clock (CP), set (SD) inputs, true and complementary outputs. The asynchronous SD input, when low, forces the outputs to the steady state levels as shown in the function table regardless of the level 文件：81.65 Kbytes 頁數(shù)：10 Pages	PHI PHI	PHI
74F113	文件：300 bytes Page：1 Pages	Dual JK Negative Edge-Triggered Flip-Flop	ONSEMI 安森美半導(dǎo)體	ONSEMI
74F113PC	文件：59.83 Kbytes Page：6 Pages	Dual JK Negative Edge-Triggered Flip-Flop General Description The 74F113 offers individual J, K, Set and Clock inputs. When the clock goes HIGH the inputs are enabled and data may be entered. The logic level of the J and K inputs may be changed when the clock pulse is HIGH and the flipflop will perform according to the Truth Table as lo 文件：59.83 Kbytes 頁數(shù)：6 Pages	FAIRCHILD 仙童半導(dǎo)體	FAIRCHILD
74F113SC	文件：59.83 Kbytes Page：6 Pages	Dual JK Negative Edge-Triggered Flip-Flop General Description The 74F113 offers individual J, K, Set and Clock inputs. When the clock goes HIGH the inputs are enabled and data may be entered. The logic level of the J and K inputs may be changed when the clock pulse is HIGH and the flipflop will perform according to the Truth Table as lo 文件：59.83 Kbytes 頁數(shù)：6 Pages	FAIRCHILD 仙童半導(dǎo)體	FAIRCHILD
74F113SJ	文件：59.83 Kbytes Page：6 Pages	Dual JK Negative Edge-Triggered Flip-Flop General Description The 74F113 offers individual J, K, Set and Clock inputs. When the clock goes HIGH the inputs are enabled and data may be entered. The logic level of the J and K inputs may be changed when the clock pulse is HIGH and the flipflop will perform according to the Truth Table as lo 文件：59.83 Kbytes 頁數(shù)：6 Pages	FAIRCHILD 仙童半導(dǎo)體	FAIRCHILD
74F113PC	文件：100 bytes Page：1 Pages	Package：14-DIP（0.300"，7.62mm）；包裝：袋功能：設(shè)置（預(yù)設(shè)）和復(fù)位類別：集成電路（IC）觸發(fā)器描述：IC FF JK TYPE DUAL 1BIT 14DIP	ONSEMI 安森美半導(dǎo)體	ONSEMI

詳細(xì)參數(shù)

型號：
74F113
功能描述：
觸發(fā)器 Dual J-K Flip-Flop
RoHS：
否
制造商：
Texas Instruments
電路數(shù)量：
2
邏輯系列：
SN74
邏輯類型：
D-Type Flip-Flop
極性：
Inverting, Non-Inverting
輸入類型：
CMOS
傳播延遲時(shí)間：
4.4 ns
高電平輸出電流：
- 16 mA
低電平輸出電流：
16 mA
電源電壓-最大：
5.5 V
最大工作溫度：
+ 85 C
安裝風(fēng)格：
SMD/SMT
封裝/箱體：
X2SON-8
封裝：
Reel

供應(yīng)商	型號	品牌	批號	封裝	庫存	備注	價(jià)格
深圳市一線半導(dǎo)體有限公司	74F113	NATIONAL	24+	SMD-14	500		詢價(jià)
上海鑫科潤電子科技有限公司	74F113	NS	97+	SOP-14/3.9mm	161	原裝現(xiàn)貨海量庫存歡迎咨詢	詢價(jià)
深圳市佳鑫美電子科技有限公司	74F113	NS	25+	SOP3.9	2987	絕對全新原裝現(xiàn)貨供應(yīng)!	詢價(jià)
上海金慶電子技術(shù)有限公司	74F113	FAIRCHILD	新		728	全新原裝貨期兩周	詢價(jià)
深圳市宇創(chuàng)芯科技有限公司	74F113	NS	24+	SOP-14	9600	原裝現(xiàn)貨,優(yōu)勢供應(yīng),支持實(shí)單!	詢價(jià)
深圳市威爾健半導(dǎo)體有限公司	74F113	NS/國半	23+	SOP-3.9	50000	全新原裝正品現(xiàn)貨,支持訂貨	詢價(jià)
深圳龐田科技有限公司	74F113	FAIRCHILD	2023+環(huán)?，F(xiàn)貨	SOP14	10	專注軍工、汽車、醫(yī)療、工業(yè)等方案配套一站式服務(wù)	詢價(jià)
深圳市中遠(yuǎn)芯科技有限公司	74F113	NS	96	SOP14	418	原裝現(xiàn)貨	詢價(jià)
深圳市科芯源微電子有限公司	74F113	NS	25+	SOP-14	65428	百分百原裝現(xiàn)貨實(shí)單必成	詢價(jià)
深圳市聯(lián)世界科技有限公司	74F113SCX	NAT	24+/25+		2500	原裝正品現(xiàn)貨庫存價(jià)優(yōu)	詢價(jià)

更多74F113供應(yīng)商更新時(shí)間2026-1-19 16:30:00

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