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74F112SC	文件：59.07 Kbytes Page：6 Pages	Dual JK Negative Edge-Triggered Flip-Flop General Description The 74F112 contains two independent, high-speed JK flip flops with Direct Set and Clear inputs. Synchronous state changes are initiated by the falling edge of the clock. Triggering occurs at a voltage level of the clock and is not directly related to the transition time. The J 文件：59.07 Kbytes 頁數(shù)：6 Pages	FAIRCHILD 仙童半導(dǎo)體	FAIRCHILD
74F112SC	文件：83.34 Kbytes Page：7 Pages	Dual JK Negative Edge-Triggered Flip-Flop 文件：83.34 Kbytes 頁數(shù)：7 Pages	FAIRCHILD 仙童半導(dǎo)體	FAIRCHILD
74F112SC	文件：100 bytes Page：1 Pages	Package：16-SOIC（0.154"，3.90mm 寬）；包裝：管件功能：設(shè)置（預(yù)設(shè)）和復(fù)位類別：集成電路（IC）觸發(fā)器描述：IC FF JK TYPE DUAL 1BIT 16SOIC	ONSEMI 安森美半導(dǎo)體	ONSEMI
74F112SCX	文件：100 bytes Page：1 Pages	Package：16-SOIC（0.154"，3.90mm 寬）；包裝：管件功能：設(shè)置（預(yù)設(shè)）和復(fù)位類別：集成電路（IC）觸發(fā)器描述：IC FF JK TYPE DUAL 1BIT 16SOIC	ONSEMI 安森美半導(dǎo)體	ONSEMI

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更多74F112SC供應(yīng)商更新時(shí)間2026-1-21 22:59:00